基于PSoC3和PSoC5的嵌入式数字滤波技术 (1)
带模数前端的低成本微控制器近年来得到迅速推广，人们通常称之为“混合信号微控制器”。当然，赛普拉斯的 PSoC3 和新近推出的PSoC5 器件集成了强大的CPU和业界领先的ADC，其性能可超过分离式外部转换器。不过，PSoC3 和 PSoC5并不仅仅是一般的混合信号微控制器。传统设备当然可以将外部模拟信号转换为数字信号。数据采集进程并不是全部目的之所在，它只是通过数据采集提取所采集数据背后含义并确定如何处理数据的一种方式。如果提取含义所需的信号处理工作量非常大的话，就会对固件工程师构成挑战，因为这种提取工作要与一般性工作任务使用相同的处理器，而处理器在支持终端设备所需的一般性任务之外还要完成新的工作任务。
在定义关系密切的 PSoC3 和 PSoC5系列产品时，赛普拉斯的架构师决定不再在竞争激烈的市场中仅仅提供一款同质化的产品。不管采取什么架构，硬件的功能都应重点用于高效地实现有用的工作目的。我们希望PSoC 真正成为片上可编程解决方案，能够解决实际客户遇到的实际问题。为了给新一代 PSoC器件提供更强的解决问题的功能，我们采用了一系列独特的外设和信号处理块，既有模拟的，也有数字的。本文将重点讨论这些大幅简化采集信号数字滤波工作的信号处理块，并讨论该技术已经在其中证明自身实力的一些应用。
嵌入式数字滤波的架构增强
首先，我们为什么希望使用嵌入式滤波器而不是将信号处理指令集成到普通的微控制器中呢？究其原因就是项目设计层面和系统集成层面的分区问题。在项目开发过程中，项目的规模、目标和整体架构经常发生变化。单核单片式编码项目要想跟上这种变化的速度，着实是一个挑战，尤其是目前的项目常常是由非集中化的多个不同设计团队一起完成的，这更增加了相关的难度。在块层所使用的功能元件中嵌入信号处理，能确保项目管理在元件设计层面实现分支，同时也能确保在算法改变时，信号处理负载发生的差异不会影响通信管理等时间关键性任务。
数字滤波器块 (DFB) 是首款PSoC3 和 PSoC5系列产品中支持嵌入式数字滤波的硬件元素，这是一款连接于外设总线的小型数字滤波器引擎。实际上，它是存储器、MAC、ALU和微代码控制库的紧密组合，其 VLIW 架构能支持不同的操作，如24位 x 24 位到 48位乘法和加法等能以系统时钟速率并行执行，在 PSoC3 中的频率可高达 67MHz，而在 PSoC5 中的频率则可达80MHz。数据和系数存储在一对专门的本地 128x24位存储器中，并能在整个系统总线上进行存取。许多滤波拓扑都能在这一结构上高效编码。配合嵌入式数字滤波应用 DFB 的是通用数字块 (UDB) 阵列。它在多功能架构中结合了 PLD 和数据路径／ALU块，既能用于数字数据源集和汇集连接，也能用于高时钟速率重复结构，如级联积分器／梳状滤波器 (CIC)和噪声成形数字转换器。
在 PSoC3 和 PSoC5 系统中如何使用嵌入式数字滤波
数字滤波器块可通过几种方式使用。PSoC Creator中集成的滤波器设计工具支持拖放工作方式，将数字滤波包括到信号流程中来。启动时 PSoC Creator 配套提供了专用的FIR滤波器“组件”，在系统中可以像其他块一样使用。该组件能对信号应用多种不同滤波器，既能单独使用，也能组合使用。图1显示了该组件的屏幕截图，从中我们看出它在 PSoC Creator项目中的使用情况以及设置属性的配置窗口。今后，更多滤波器拓扑和互动滤波器设计向导还将添加到 PSoC Creator中。
